Вычислительная система обработки данных в реальном времени

Содержание

Введение

Техническии задание для разработки

Анализ исходных данных

Выбор элементной базы

Разработка программного обеспечения

Тест ПЗУ

Алгоритм вычисления функции

Разработка структурной схемы

Проектирование функциональной схемы

Оценка быстродействия системы

Список использованной литературы

Приложение. Листинг программы

Введение

Курсовая работа выполняется с целью закрепления знаний, полученных из курса "Организация ЭВМ и систем", а также, основываясь на ранее изученных дисциплинах таких, как "Информатика", "Языки программирования" и "Электротехника и электроника", помогает их лучшему восприятию.

Основными задачами работы является:

практическое овладение методикой проектирования вычислительной системы на основе современной элементной базы, технических средств вычислительной техники, а также теории организации ЭВМ и систем;

оценка параметров проектируемой системы и повышение качества проектирования;.

приобретение практических навыков оформления и выпуска конструкторской документации в соответствии с ГОСТ.

Техническии задание для разработки

В курсовом проекте проектируется вычислительная система, предназначенная для реализации заданного алгоритма обработки входного аналогового сигнала и структурно состоящая из устройств:

персональной ЭВМ (ПЭВМ) типа IBM PC/AT-386 и выше;

устройства ввода (УВ), связанного с ПЭВМ через стандартный интерфейс.

Устройство ввода состоит из блока цифровой программной обработки и интерфейсного блока, работающих одновременно и обеспечивающих обработку и ввод информации в ПЭВМ.

Разрабатываемая система должна функционировать в режиме реального времени, т.е. запаздывание потока результатов от потока входной информации должно быть ограничено.

Исходные данные для процесса проектирования описаны ниже:

Структуру блока цифровой обработки: однопроцессорная система на базе комплекта К1810 в минимальном режиме;

Вид функции, выполняемой блоком цифровой обработки: остаток от деления произведения двух последних принятых входных значений на предыдущее;

Тип синхронизации: с синхронизацией по готовности данных;

Тип стандартного интерфейса для связи УВ и ПЭВМ: параллельный порт.

Анализ исходных данных

Анализ задания позволяет сделать следующие предварительные выводы:

1. Максимальная разрядность интерфейса системной шины равна 16. Данное обстоятельство обуславливает выбрать разрядность входного и выходного слова 16 бит;

2. Так как задан комплект К1810 в минимальном режиме, то потребуется использовать следующие микросхемы: генератор тактовых импульсов К1810ГФ84, два буферных регистра К1810ИР82, два двунаправленных шинных формирователя К1810ВА86;

3. Цифровой сигнал 16-ти битовый, поэтому необходимо использовать два буферных регистра, каждый разрядностью 8 бит, необходимые для разделения входного сигнала на 16 разрядные слова. Если регистры не использовать, то большая часть данных будет потеряна;

4. Проанализировав функцию, ясно что в при ее выполнении можно обойтись внутренними регистрами микропроцессора, поэтому нет необходимости использовать ОЗУ. Вся программа хранится в ПЗУ;

5. В качестве параллельного порта будет использовать микросхему К580ВВ55, у которой 3 8-разрядных порта, для вывода данных будем использовать 2 из них, то есть обеспечим передачу слова;

6. В параллельном порте будет использовать бит 0 в порте С в качестве бита готовности данных, по которым ПЭВМ определит, что выходные данные поступили в порты А и В.

Анализ исходных данных позволяет выбрать элементы, назначение и описание выводов которых приведено в следующем пункте курсовой работы.

Выбор элементной базы

Микросхема К1810ВМ86

Микропроцессор К1810ВМ86 представляет собой однокристальный 16-битовый МП работающий в данной вычислительной системе в минимальном режиме. Этот модуль производит чтение ПЗУ, а также чтение и запись в порты ввода-вывода. Условное графическое обозначение МП К1810ВМ86 приведено на рис.2. Опишем его выводы, используемые при проектировании системы.

AD15- AD0 - мультиплексная двунаправленная шина адреса/данных, по которой с разделением во времени передаются адресная информация и данные;

- разрешение старшего байта, активный сигнал означает, что по старшей половине AD15-AD8 передаются 8 - битовые данные. Он защелкивается во внешнем регистре адреса и используется как дополнительный адресный выход, определяющий доступ к старшему банку памяти. Совместное использование и младшей линии адреса А0 для дешифрации адресов позволяет осуществлять передачу слов или отдельных байтов по шине АD;

ALE - строб адреса (разрешение защелкивания адреса), выдается в начале каждого цикла шины и используется для записи адреса в регистр - защелку, т.е. для демультиплексирования шины AD;

- строб данных (разрешение передачи данных). Выдается в циклах чтения, записи и разрешения входа шинных формирователей;

- чтение, идентифицирует выполнения цикла чтения из ЗУ или внешнего устройства (в зависимости от значения сигнала ). Указывает этим устройствам на необходимость выдачи данных на шину;

- запись, указывает на выполнение цикла записи ЗУ или ВУ и сопровождает д

Внимание, отключите Adblock

Вы посетили наш сайт со включенным блокировщиком рекламы!
Ссылка для скачивания станет доступной сразу после отключения Adblock!

Скачать